Mudanças entre as edições de "Ssc-113"

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(SSC 113 - Elementos de Lógica Digital 2)
(SSC 113 - Elementos de Lógica Digital 2)
 
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  Cálculo da média: média harmônica de: P1 (peso 1), P2 (peso 1) e Proj (peso 2)   
 
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Edição atual tal como às 11h03min de 2 de dezembro de 2013

SSC 113 - Elementos de Lógica Digital 2

Prof. Denis F. Wolf (denis@icmc.usp.br)

Teoria: quinta, as 10:10

Laboratório: sexta, as 8:00 e 10:10


Estagiários PAE:

Alberto Hata (hata@icmc.usp.br)

Francisco A. Alencar (alealencar@gail.com)


Objetivos: Estender o conhecimento do aluno em técnicas digitais, com ênfase no projeto de circuitos sequenciais.


Programa: Revisão de circuitos combinacionais. Projeto de lógica seqüencial e casos de estudos. Projeto de máquinas de estado finito-FSM (Finite State Machine). Técnicas de otimização de máquinas de estado finito. Implementação de máquinas de estado finito, utilizando-se, opcionalmente, circuitos de lógica reprogramável tipo FPGA (Field-Programmable Gate Array). Aulas práticas de laboratório.


Avaliações:

Prova 1:  27/9
Prova 2:   5/12
Projeto:  28/11
Cálculo da média: média harmônica de: P1 (peso 1), P2 (peso 1) e Proj (peso 2)  

Notas:

Arquivo:SSC113-notas.pdf


Avaliações:

Aula 1: Apresentação

Aula 2: VHDL (D´Amore cap. 1 até 6.5)


Bibliografia:

- Roberto d'Amore, VHDL Descrição e Síntese de Circuitos Digitais, LTC.

- Stephen Brown, Zvonko Vranesic, Fundamentals of Digital Logic with VHDL Design, McGraw Hill.

- KATZ, R.H. Contemporary Logic Design, The Benjamin/Cummings Publishing, 1994.

Material Didático (Roberto d'Amore):

Arquivo:SSC113-Slide 1.pdf

Arquivo:SSC113-Slide 2a.pdf

Arquivo:SSC113-Slide 2b.pdf

Arquivo:SSC113-Slide 3.pdf

Arquivo:SSC113-Slide 4a.pdf

Arquivo:SSC113-Slide 4b.pdf

Arquivo:SSC113-Slide 5.pdf

Arquivo:SSC113-Slide 6.pdf

Arquivo:SSC113-Slide 7.pdf

Arquivo:SSC113-Slide 8-Maquinas de Estados.pdf

Teclado e Display da placa DE2-70:

Arquivo:Teclado.zip

Arquivo:Teclado.pdf

Arquivo:Display.zip

Arquivo:Display.pdf

Processador (Roberto d'Amore):

Arquivo:Processador.zip

Informações do processador

Projeto:

Projeto