Mudanças entre as edições de "SSC-110"
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Dispositivos eletrônicos semicondutores: Noções da física dos semicondutores. Sistemas de Numeração, Álgebra de Boole e portas lógicas. Implementação de Portas Lógicas. Simplificação de expressões lógicas (mapa de Karnaugh) e implementação dos circuitos. Códigos: ASCII, EBCDIC, HAMMING, GRAY, etc. Noções de circuitos combinacionais e sequências. Subsistemas lógicos: multiplex, demultiplex, decodificador, memória, latch, flip-flop, registradores e contadores. | Dispositivos eletrônicos semicondutores: Noções da física dos semicondutores. Sistemas de Numeração, Álgebra de Boole e portas lógicas. Implementação de Portas Lógicas. Simplificação de expressões lógicas (mapa de Karnaugh) e implementação dos circuitos. Códigos: ASCII, EBCDIC, HAMMING, GRAY, etc. Noções de circuitos combinacionais e sequências. Subsistemas lógicos: multiplex, demultiplex, decodificador, memória, latch, flip-flop, registradores e contadores. | ||
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* IDOETA,I.V.; CAPUANO, F.G. Elementos de Eletrônica Digital, Livros Érica | * IDOETA,I.V.; CAPUANO, F.G. Elementos de Eletrônica Digital, Livros Érica | ||
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Edição das 16h41min de 5 de agosto de 2010
SSC 0110- Elementos de Lógica Digital I
Prof. Denis Wolf (denis@icmc.usp.br)
Programa:
Dispositivos eletrônicos semicondutores: Noções da física dos semicondutores. Sistemas de Numeração, Álgebra de Boole e portas lógicas. Implementação de Portas Lógicas. Simplificação de expressões lógicas (mapa de Karnaugh) e implementação dos circuitos. Códigos: ASCII, EBCDIC, HAMMING, GRAY, etc. Noções de circuitos combinacionais e sequências. Subsistemas lógicos: multiplex, demultiplex, decodificador, memória, latch, flip-flop, registradores e contadores.
Bibliografia:
- BROWN, S. ; VRANESIC, Z. Fundamentals of Digital Logic with VHDL Design, McGraw Hill.
- IDOETA,I.V.; CAPUANO, F.G. Elementos de Eletrônica Digital, Livros Érica
Avaliação:
P1: 5/10/10 (peso 2)
P2: 16/11/10 (peso 3)
Projeto: 30/11/10 (peso 2)
SE (média das provas > 5.0) E (projeto > 5.0) ENTÃO média final = (2*P1 + 3*P2 + 2*Proj) / 7 SENÃO média final = menor (média das provas, projeto)
