Mudanças entre as edições de "SSC-113"
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Edição das 09h46min de 26 de outubro de 2010
No Jupiter-web: [ementa]
Recados
- Prof. Vanderlei
- Os projetos Máquina de Refrigerante tipo Mealy implementado direto em VHDL e o do Elevador com o ActiveHDL deverão ambos serem concluídos durante as aulas 14 e 15/07.
Informações Gerais
Disciplina: Elementos de Lógica Digital II (SSC-113) - BCC
Professores:
- Turma A - Eduardo do Valle Simões (simoes at icmc dot usp dot br)
- Turma B - Vanderlei Bonato (vbonato at icmc dot usp dot br)
Aluno PAE: Sérgio Durand (durand at icmc dot usp dot br )
Horário e Local das Aulas:
- Turma A:
- Teórica: seg 13:30 - 16:00 (02:30 horas) - sala 5001
- Prática: ter 08:10 - 09:50 (01:40 hora ); qua (01:40 hora ) 10:10 - 11:50 - SAP2
- Turma B:
- Teórica: seg 13:30 - 16:00 (02:30 horas) - sala 5003
- Prática: ter 10:10 - 11:50 (01:40 hora ); qua 08:10 - 09:50 (01:40 hora ) - SAP2
Horário de Atendimento:
- Professor: seg 16:00 - 18:00
- Aluno PAE: qua 16:00 - 18:00 (avisar por e-mail)
Aulas Programadas
- Aula 1 - Apresentação do curso
- Aula 2 - Linguagem de descrição de hardware VHDL
- Aula 3 - Máquina de estados finitos
- Aula 4 - Modelos de máquinas de estados finitos - Moore e Mealy (exercícios)
- Máquina de venda de refrigerante
- Aula 5 - Máquina de estados finitos (continuação)
- Aula 6 - Apresentação P1
- Aula 7 - Template de microprocessador (memória, mapa de caracteres, I/O, ULA, unidade de controle)
- Aula 8 - Análise e implementaçao: instruções de acesso a memória e I/O
- Aula 9 - Análise e implementaçao: instruções de operações artiméticas, lógicas e de deslocamento
- Aula 10 - Análise e implementaçao: instruções de desvios
- Aula 11 - Análise e implementaçao: instruções de subrotinas
- Aula 12 - Montador
- Aula 13 - Programação
- Aula 14 - Programação
- Aula 15 - Apresentação P2
Material de Apoio
- Fontes VHDL
- Dicas VHDL/Quartus
- Processador COMP09
- Docs para uso da Placa D2-70
