Mudanças entre as edições de "SSC-113"
De CoteiaWiki
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**Máquina de venda de refrigerante | **Máquina de venda de refrigerante | ||
*Aula 5 - Máquina de estados finitos (continuação) | *Aula 5 - Máquina de estados finitos (continuação) | ||
| − | *Aula 6 - Apresentação P1 | + | *Aula 6 - Apresentação P1 (06/08/2011) |
*Aula 7 - Template de microprocessador (memória, mapa de caracteres, I/O, ULA, unidade de controle) | *Aula 7 - Template de microprocessador (memória, mapa de caracteres, I/O, ULA, unidade de controle) | ||
*Aula 8 - Análise e implementaçao: instruções de acesso a memória e I/O | *Aula 8 - Análise e implementaçao: instruções de acesso a memória e I/O | ||
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*Aula 13 - Programação do P2 no Processador | *Aula 13 - Programação do P2 no Processador | ||
*Aula 14 - Programação do P2 no Processador | *Aula 14 - Programação do P2 no Processador | ||
| − | *Aula 15 - Apresentação P2 | + | *Aula 15 - Apresentação P2 (29/11/2011) |
== Material de Apoio == | == Material de Apoio == | ||
Edição das 16h23min de 1 de agosto de 2011
No Jupiter-web: [ementa]
Índice
[ocultar]Recados
Informações Gerais
Disciplina: Elementos de Lógica Digital II (SSC-113) - BCC
Professores:
- Turma A - Eduardo do Valle Simões (simoes at icmc dot usp dot br)
- Turma B - Eduardo Marques/Alexandre Delbem (emarques ou acdb at icmc dot usp dot br)
Horário e Local das Aulas:
- Turma A:
- Teórica: ter 13:30 - 16:00 (02:30 horas) - sala 5001
- Prática: ter 10:10 - 11:50 (01:40 hora ); qua (01:40 hora ) 10:10 - 11:50 - SAP2: Sala 6-306
- Turma B:
- Teórica: ter 13:30 - 16:00 (02:30 horas) - sala 5003
- Prática: qui 10:10 - 11:50 (01:40 hora ); sex 16:20 - 18:00 (01:40 hora ) - SAP2: Sala 6-306
Horário de Atendimento:
- Professor Eduardo Simoes: qui 17:00 - 19:00
(agendar por e-mail)
Aulas Programadas
- Aula 1 - Apresentação do curso
- Aula 2 - Linguagem de descrição de hardware VHDL
- Aula 3 - Máquina de estados finitos
- Aula 4 - Modelos de máquinas de estados finitos - Moore e Mealy (exercícios)
- Máquina de venda de refrigerante
- Aula 5 - Máquina de estados finitos (continuação)
- Aula 6 - Apresentação P1 (06/08/2011)
- Aula 7 - Template de microprocessador (memória, mapa de caracteres, I/O, ULA, unidade de controle)
- Aula 8 - Análise e implementaçao: instruções de acesso a memória e I/O
- Aula 9 - Análise e implementaçao: instruções de operações artiméticas, lógicas e de deslocamento
- Aula 10 - Análise e implementaçao: instruções de desvios
- Aula 11 - Análise e implementaçao: instruções de subrotinas
- Aula 12 - Montador
- Aula 13 - Programação do P2 no Processador
- Aula 14 - Programação do P2 no Processador
- Aula 15 - Apresentação P2 (29/11/2011)
Material de Apoio
- Fontes VHDL
- Dicas VHDL/Quartus
- Processador COMP09
- Docs para uso da Placa D2-70
Resultados das Avaliações
- Recuperação:
- Data: 15/12/2011
- Horário: 14:00hs
- Local: Sala 6-306 - Laboratório SAP-2
